SJ/T10566-1994 SJ/T 10566-1994 可测性总线 第一部分：标准测试存取口与边界扫描结构
标准编号：SJ/T 10566-1994 时间：1994-08-08 大小：KB 浏览次数：52 下载次数：7| 资料名称： | SJ/T10566-1994 SJ/T 10566-1994 可测性总线 第一部分：标准测试存取口与边界扫描结构 | |
| 标准类别： | 行业标准 | ||
| 语 言： | 简体中文 | ||
| 文件类型： | .rar | ||
| 整理时间： | 1994-08-08 | ||
| 授权方式： | 免费下载 | ||
| 下载方式： | FTP下载 | ||
| 等 级： |  |
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| 标准状态： | （仅供参考） | ||
| 作废日期： | （仅供参考） | ||
| 实施日期： | 1994-12-01（仅供参考） | ||
| 浏览次数： | 52次 |
| 标准简介： | SJ/T 10566-1994 可测性总线 第一部分：标准测试存取口与边界扫描结构 电子行业标准(SJ) SJ/T10566-1994 本标准规定了数字集成电路和模拟/数字混合集成电路的数字部分用的测试存取口（TAP）与边界扫描结构。本标准规定的测试逻辑可包含在集成电路内，由一个边界扫描寄存器和若干其它块构成，并可通过测试存取口进行存龋本标准适用于在集成电路组装在一块印制电路板或其它基底上后测试集成电路间的互连性、测试集成电路本身和在这个器件正常工作期间观测或修改电路的动作。 标准压缩包解压密码：www.51zbz.com |
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| 标准编号： | SJ/T 10566-1994 正在载入地址 | |
| 标准名称： | 可测性总线 第一部分：标准测试存取口与边界扫描结构 | |
| 英文名称： | Testability bus -Part 1:Standard test access port and boundary scan architecture（仅供参考） | |
| 替代情况： | （仅供参考） | |
| 采标情况： | ANSI/IEEE 1149.1-90 NEQ（仅供参考） | |
| 发布部门： | 中华人民共和国电子工业部（仅供参考） | |
| 页 数： | 89页（仅供参考） | |
| 首发日期： | （仅供参考） | |
| 复审日期： | （仅供参考） | |
| 提出单位： | （仅供参考） | |
| 归口单位： | 电子工业部标准化研究所（仅供参考） | |
| 主管部门： | （仅供参考） | |
| 起草单位： | 天津大学、北京自动测试技术研究所（仅供参考） | |
| 相关标准： |
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| 下载次数： | 7次 | |
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